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  2025.09.04
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開發(fā)要求說明

本項(xiàng)目要求基于賽靈思（Xilinx）開發(fā)板實(shí)現(xiàn)一套真實(shí)萬兆網(wǎng)卡（例如 Intel X520-DA2）的 PCIe 透明透傳方案。開發(fā)板需作為主機(jī)與網(wǎng)卡之間的物理中間層進(jìn)行橋接，但必須保證 主機(jī)在 PCIe 枚舉時(shí)僅能識(shí)別到原生網(wǎng)卡設(shè)備，而不會(huì)枚舉到中間的開發(fā)板，從而確保系統(tǒng)始終保持對(duì)網(wǎng)卡的原生驅(qū)動(dòng)支持和完整的網(wǎng)絡(luò)功能。

在透明透傳的基礎(chǔ)上，需要在橋接路徑中集成一個(gè) DMA 引擎，用于受控 DMA 訪問與性能觀測(cè)。該 DMA 引擎需滿足以下限定條件：

• DMA 的讀寫操作必須通過 USB 接口完成，接口芯片為 FT601，并通過 USB 連接至測(cè)試電腦運(yùn)行測(cè)試工具包；

• 開發(fā)板需通過 FMC 轉(zhuǎn)接卡來實(shí)現(xiàn)與 FT601 芯片的連接與數(shù)據(jù)交互；

• DMA 引擎的有效讀寫速率 不得低于 250MB/s，以保證觀測(cè)和性能測(cè)試的有效性；

• 我們將提供基于 Artix-7 平臺(tái)的 DMA 引擎源碼參考以及配套測(cè)試工具，開發(fā)團(tuán)隊(duì)需根據(jù)源碼特性進(jìn)行移植與實(shí)現(xiàn)。

此外，系統(tǒng)整體性能必須滿足以下要求：透明橋接引入的額外網(wǎng)絡(luò)延遲不得超過 100ms，以確保透傳過程中對(duì)原生萬兆網(wǎng)卡網(wǎng)絡(luò)性能的影響保持在可接受范圍內(nèi)。

本項(xiàng)目中包含更多內(nèi)容

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